FPGA时序分析和约束  丛书名：  责任者：常建芳  ISBN：978-7-302-69982-8 索书号：TP332.1 9140 ZAFU (找书请记录索书号）  中图分类：TP332.1 价格：69.00  出版地：北京 主题词：可编程逻辑器件  文献类型：图书 出版时间：2025  出版社：清华大学出版社 摘要(Abstract) 本书共8章，第1章以生活场景时序例子开篇，介绍FPGA及Vivado编译工具，阐述时序分析和约束意义，描述FPGA时序约束整体框架。第2章从建立/保持时间、启动沿/锁存沿等概念切入，分析io2reg、reg2reg、reg2io和io2io四种基本路径时序。第3章聚焦时钟分析与约束，涵盖主时钟、抖动、不确定性、延时、虚拟时钟和衍生时钟约束。第4章讲述输入/输出延时约束，依次分析输入延时约束和输出延时约束。第5章开篇阐述时序例外约束意义，分析伪路径、时钟组、最大/最小延时、多周期路径约束，说明其优先级和逻辑设计方法。第6章汇总其他时序约束，如CaseAnalysis、DisableTiming等。第7章设计简单时序工程，覆盖前几章各种时序路径并进行约束。第8章总结时序约束技巧，分享作者学习历程并引用前辈经验资料。             数字资源(Digital Resources)    纸本资源(Paper Resources) 馆藏地 条码号 馆藏号 密集架号 借出时间 应还日期 状态 暨阳主库 (暨阳学院图书馆主库) 73250733 73250733       可借    书评(Book Review):最多输入600个字符        请勿在书评处发表对图书馆意见建议，如需建议请点击

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